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SystemVerilogによるFPGA/ﾃﾞｨｼﾞﾀﾙ回路設計入門
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小林和淑/監修 小林和淑/共著 寺澤真一/共著 吉河武文/共著 塩見準/共著 門本淳一郎/共著
目次
第1章 SystemVerilogとは
第2章 FPGAへの実装入門 第3章 ﾃﾞｨｼﾞﾀﾙ回路入門 第4章 SystemVerilogによる順序回路 第5章 SystemVerilogによるﾌﾟﾛｾｯｻの設計と実装 第6章 SystemVerilogによるASIC設計 第7章 SystemVerilogとVerilog HDLの対比と記述の罠
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